网表 编辑
在电子设计自动化中，网表，或称连线表，是指用基础的逻辑门来描述数字电路连接情况的描述方式。由于逻辑门阵列有着连线表一样的排列外观，因此称之为“网表”。
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在集成电路设计中，逻辑合成是所设计数字电路的高抽象级描述，经过布尔函数化简、优化后，转换到的逻辑门级别的电路连线网表的过程。
在电子学中，硬件描述语言是用来描述电子电路功能、行为的语言，可以在寄存器传输级、行为级、逻辑门级等对数字电路系统进行描述。随着自动化逻辑综合工具的发展，硬件描述语言可以被这些工具识别，并自动转换到逻辑门级网表，使得硬件描述语言可以被用来进行集成电路设计，并能通过逻辑仿真的形式功能验证电路功能。设计完成后，可以使用逻辑综合工具生成低抽象级别的网表。
集成电路版图，是真实集成电路物理情况的平面几何形状描述。集成电路版图是集成电路设计中最底层步骤物理设计的成果，物理设计通过布局、布线技术将逻辑综合的成果——逻辑门的网表转换成物理版图文件，这个文件包含了各个硬件单元在芯片上的形状、面积和位置信息。版图设计的结果必须遵守制造工艺、时序、面积、功耗等的约束。版图设计是借助电子设计自动化工具来完成的。集成电路版图完成后，整个集成电路设计流程基本结束。随后，半导体加工厂会接收版图文件，利用具体的半导体器件制造技术，来制造实际的硬件电路。
在集成电路设计中，逻辑合成是所设计数字电路的高抽象级描述，经过布尔函数化简、优化后，转换到的逻辑门级别的电路连线网表的过程。
在集成电路设计中，物理设计是完成功能设计之后的一个流程。在这一步，经过布图规划、布局、布线等具体过程后，以硬件描述语言等抽象形式表达的电路网表会被转换成代表电路的几何图形，这个几何图形被称为集成电路版图。半导体工厂根据版图文件就可以制造出实际的硬件电路。除了前面提到的具体过程，物理设计还包括一系列对于版图的设计和验证。